84 résultats trouvés

[Thèse]

Etude d'alliage eutectique pour la réalisation de scellement

Offre N° : SL-DRT-15-0196

Date de début : 1 Oct 2015

Le LETI est un laboratoire du CEA dédié aux recherches en microélectronique, microsystèmes et optronique. L'une de ces thématiques de recherche concerne le développement des activités de packaging pour les MEMS (MicroElectroMechanical Systems) à l'échelle de la plaque support (substrat) du composant (Wafer-Level Packaging) par scellement d'un second substrat. La technique d'assemblage entre les deux substrats est basée sur la création d'un composé eutectique fusible.



[Thèse]

Impact des mémoires non volatiles émergentes sur les systèmes d'exploitation

Offre N° : SL-DRT-15-0199

Date de début : 1 Sep 2015

Résumé

Les mémoires non-volatiles émergentes permettront de remplacer les DRAM utilisées comme mémoire vive et, partiellement, les Flash et disques durs utilisés en stockage de masse. Ces mémoires seront plus denses, moins chères et consommeront moins que les DRAM. Cette thèse a pour but de revoir l'organisation des systèmes d'exploitation pour tirer parti de leur non-volatilité afin d'optimiser les performances et la consommation des ordinateurs.

Contexte



[Thèse]

Imageurs CMOS intégrant les fonctions de détection et de recupération d'énergie dans le pixel

Offre N° : SL-DRT-15-0384

Date de début : 1 Sep 2015

Cette thèse se propose d'explorer de nouvelles architectures de capteurs d'images CMOS dédiées à des applications très fortement contraintes en énergie disponible. Ces capteurs devront être très peu consommant et capable de produire tout ou partie de leur besoin énergétique (mode photovoltaïque).



[Thèse]

Système intégré de routage réseau à base de mémoires associatives ternaires résistives

Offre N° : SL-DRT-15-0408

Date de début : 1 Jan 2015

Le travail de recherche proposé consiste à concevoir et réaliser une solution complète pour le routage des paquets réseau, s'appuyant sur les technologies de mémoires résistives développées au LETI. On repensera l'architecture du système autour d'un composant de mémoire associative ternaire original, et on proposera des solutions innovantes et optimisées pour le pré-indexage des données, et pour la mise à jour des références sans blocage.



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